Get Abstrakte Modellierung digitaler Schaltungen: VHDL vom PDF

By Klaus ten Hagen

ISBN-10: 3642796893

ISBN-13: 9783642796890

ISBN-10: 3642796907

ISBN-13: 9783642796906

Kommentare von erfahrenen Hardwareentwicklern: "Ich kenne kein Buch, daß die Modellierung von so grundlegend behandelt. Alle mir bekannten Bücher beschreiben die Sprache VHDL und bringen viele Beispiele, gehen aber nicht darauf ein, wie guy entwickelt, was once beim Umgang mit VHDL und Synthese alles passieren kann und welche Gedanken guy sich machen sollte, bevor guy beginnt, den Code zu hacken. Endlich einmal alles in einem Buch!"
"Das Buch gibt dem unerfahrenen dressmaker den richtigen Einstieg und dem erfahrenen den richtigen Umstieg. Es ist unglaublich, wie oft die Frage 'Was ist summary Modeling` gestellt wird. Hier ist die Antwort - theoretisch aufgearbeitet und mit praktischen Beispielen untermauert."

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VERIFIKATIONSMETHODEN 25 (-) Simulationdurch den Reviewer: Die "Reviewer" tiberprtifen mit Hilfe der vorliegenden Entwurfsdokumente die Eigenschaften des Entwurfes, indem sie gewisse Sequenzen von wichtigen Ereignissen manuell durchspielen. Allerdings ist der Umfang der Ereignissequenzen, welche bei einem "Review" manuel! simuliert werden konnen, durch die menschliche Geduld und die verfiigbare Zeit begrenzt. 2 diskutierte Simulation ersetzt haufig die Funktion des "Reviewers", indem man das aktuelle Modell innerhalb einer Testbench simuliert, die von einem anderen Entwickler (dem "virtuellen Reviewer") implementiert worden ist.

Rules, I suggest, derive from paradigms, but paradigms can guide research even in the absence of rules. Bevor ein Arbeitsfeld vollstandig formalisiert ist, kann durch eine Menge von Beispiel en ein Paradigma etabliert werden. Diese Situation ist aus der mechanischen Konstruktion wohlbekannt. 1m Maschinenbau muB man eine Vielzahl von Maschinenelementen und die Verwendung derselben studiert haben, bevor man in der Lage ist, eine eigene Konstruktion zu entwerfen. Ein durch charakteristische Beispiele etabliertes Paradigma kann dann von anderen Benutzern durch eine Variation angewandt werden.

Bond" -Draht geschweiBt wird [123]. chip") verwendet. 1. VERIFIKATIONSMETHODEN 25 (-) Simulationdurch den Reviewer: Die "Reviewer" tiberprtifen mit Hilfe der vorliegenden Entwurfsdokumente die Eigenschaften des Entwurfes, indem sie gewisse Sequenzen von wichtigen Ereignissen manuell durchspielen. Allerdings ist der Umfang der Ereignissequenzen, welche bei einem "Review" manuel! simuliert werden konnen, durch die menschliche Geduld und die verfiigbare Zeit begrenzt. 2 diskutierte Simulation ersetzt haufig die Funktion des "Reviewers", indem man das aktuelle Modell innerhalb einer Testbench simuliert, die von einem anderen Entwickler (dem "virtuellen Reviewer") implementiert worden ist.

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Abstrakte Modellierung digitaler Schaltungen: VHDL vom funktionalen Modell bis zur Gatterebene by Klaus ten Hagen


by Kevin
4.3

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